引用:
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作者mywang
P2應該是0.35的，P3 TUALATIN應該就已經0.13，時脈拉高主要是因為製程變進步
而非『架構』所造成
至於P4其實還有拉升時脈的空間，但INTEL放棄NETBURST架構了，35級管線的
TEJAS也胎死腹中
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P4 當然可以再往上拉, 但是90nm P4/PD要拉到可以跟當時Athlon FX-57/ X2 4800+
相當的效能, 至少要有4.2G~ 4.5G/3.8G雙核, 耗電量會高到嚇死人, 而65nm雖然功耗大幅下降, 像PD965XE只和PD840EE耗一樣的電, 但是對上FX-62, 還是不夠, 一樣要到4G+才有機會相搏...耗電量照樣很恐怖...何況conroe也研發完成, 時在沒有必要在撐下去
(根據intel的說法, E6400和PD945(3.4G)效能相若...Core 2目前預定的最高階X6800, 2.93G...如果要用PD來撐, 那大概要PD 5.5G.... 那根本不可能上市
引用:
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作者hagger
P4的時脈延展性也不如預期0.18→0.13→0.09→0.065
跨越四個製程世代才從1.5G→3.8G ，約2.5倍
是不是因為太熱所以拉不上去了？
印象中時脈延展性最佳的是P6架構
從P2 2XXMhz→P3 1400Mhz ，約5倍
這樣比較之後
有點懷疑矽晶圓是不是快到極限了？
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如果要廣義一點
Conroe也是P6喔
這樣P6就從Pentium Pro 150MHz到目前已知X6800, 2.93G, 20倍